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Job VacancyDéveloppeur Java Back confirmé (H/F)

Amiltone
Published on
Java

35k-40k €
Aix-en-Provence, Provence-Alpes-Côte d'Azur
Intégré à nos équipes sur notre Factory ou chez nos clients, vous interviendrez en tant Développeur Java Back Confirmé (H/F) pour intervenir sur un projet d'envergure au sein d'un environnement technique exigeant. Vous intégrerez une équipe Agile et contribuerez au développement ainsi qu'à l'évolution d'applications critiques, en intervenant sur des architectures distribuées et des échanges entre différents composants logiciels. Vos missions : - Participer à la conception technique des solutions. - Développer de nouvelles fonctionnalités en Java. - Concevoir et faire évoluer les mécanismes d'échange entre les différents composants applicatifs. - Participer à l'intégration avec les systèmes existants. - Produire un code robuste, maintenable et conforme aux bonnes pratiques de développement. - Réaliser les tests unitaires et contribuer aux tests d'intégration. - Participer aux revues de code et aux actions d'amélioration continue. - Analyser et faire évoluer un patrimoine applicatif existant. - Participer aux cérémonies Agile et contribuer aux estimations techniques. - Rédiger et maintenir la documentation technique. Vos compétences techniques : - Java - Maven - Git - Linux (Debian) - Eclipse RCP - JIRA / Confluence - Systèmes industriels - Environnements de simulation - Langages C ou Fortran - Modélisation CAO
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Contractor

Contractor jobConsultant Senior CCP Risk & Clearing | Margining, Default Fund & Stress Testing

NOVAMINDS
Published on
Python

5 months
610 €
Ile-de-France, France
Mission de l'équipe : L'équipe intervient dans l'évaluation indépendante de la résilience des chambres de compensation, de l'adéquation des mécanismes de marge et des risques financiers liés aux activités de clearing. La mission vise à renforcer l'analyse des expositions aux CCP et Clearing Members, à challenger les dispositifs de margining et de Default Fund et à développer des capacités indépendantes de simulation et de stress testing. 1. Cartographie des CCP et suivi des expositions La mission sera chargée de construire et maintenir une cartographie complète des CCP et Clearing Members sur les activités house et client. Les travaux porteront notamment sur : • L'analyse détaillée des marges et contributions aux Default Funds • Le suivi du collateral posté et reçu • L'analyse des sensibilités par classe d'actifs • Le suivi quotidien des expositions 2. Analyse des frameworks de marge des CCP La mission devra documenter et évaluer les méthodologies de marge utilisées par les différentes CCP. L'analyse couvrira notamment : • Les facteurs de risque et leur calibration • Le niveau de sophistication des modèles • Les différentes composantes de marge • Les risques de concentration et de liquidité • Les stress add ons • SUMA • DFAM • Wrong Way Risk • Les mécanismes anti procyclicité • Le backtesting • Les ratios de couverture Une analyse comparative des différents frameworks de marge devra également être produite. 3. Analyse des Default Funds et de la solidité des CCP La mission devra analyser les mécanismes de dimensionnement des Default Funds, notamment : • Les dispositifs Cover 2+ • Les scénarios de stress • Les contributions des Clearing Members • Le loss waterfall Elle participera également à l'évaluation de la solidité financière des CCP à travers l'analyse de leur capitalisation, de la qualité de leurs Default Funds et de leurs rulebooks. 4. Simulations indépendantes et stress testing La mission devra développer des capacités indépendantes de simulation des marges et de scénarios de risque de contrepartie. Les analyses devront notamment intégrer : • Des mouvements extrêmes de marché • Des chocs de volatilité • La matérialisation de risques de concentration • Le reverse engineering des mécanismes de marge Les travaux nécessiteront une forte capacité quantitative ainsi qu'une maîtrise de Python. 5. Gouvernance et instances risques La mission contribuera à la préparation des comités risques consacrés aux CCP ainsi qu'aux travaux associés aux forums professionnels du clearing. Prestations demandées Les principales responsabilités seront les suivantes : • Construire et maintenir la cartographie des CCP, Clearing Members et expositions associées • Produire des dashboards de suivi des expositions • Documenter et challenger les méthodologies de marge des CCP • Réaliser des analyses comparatives des différents frameworks • Analyser le dimensionnement et les mécanismes des Default Funds • Évaluer la solidité financière et les dispositifs de gestion des risques des CCP • Développer des modèles indépendants de simulation de marge sous Python • Construire et analyser des scénarios de stress • Contribuer à la préparation des comités risques et aux travaux de place liés au clearing Livrables attendus : • Cartographie des CCP et dashboards d'exposition • Documentation et analyse comparative des frameworks de marge • Modèles indépendants de simulation de marge • Analyses de scénarios et stress tests Secteur d'activité : Marchés financiers / Clearing Calendrier : du 01/10/2026 au 01/03/2027, renouvellement possible
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Contractor

Contractor jobArchitecte Solution Si & Performance F/H

PARTENOR
Published on
Architecture
MOE
Technical writing

2 years
520-700 €
Paris, France
Notre client, acteur majeur du secteur de l'énergie et de la gestion des réseaux électriques, recherche un Lead Tech / Architecte Solution pour accompagner l'évolution d'une application stratégique dédiée à la simulation et à l'analyse de réseaux électriques. Cette solution permet d'exécuter un volume important de simulations afin d'analyser différents scénarios d'évolution du réseau : variations de consommation et de production, incidents sur les infrastructures, études de planification ou encore simulations liées aux investissements. Dans le cadre de la préparation d'une nouvelle version majeure de la solution, notre client souhaite réaliser une étude approfondie de l'architecture actuelle afin d'identifier les leviers d'amélioration de la performance et de définir une architecture cible adaptée aux futurs besoins de la solution. Missions : En tant que Lead Tech / Architecte Solution, vous intervenez sur les enjeux d'architecture, de performance et d'évolution de la solution. Auditer l'architecture et la solution existante Votre première mission consiste à réaliser un audit technique et architectural de la solution actuelle, avec un focus particulier sur les problématiques de performance. Vous serez notamment amené à : Analyser l'architecture applicative et technique existante. Comprendre les différents composants, flux, traitements et interactions entre les systèmes. Identifier les principaux points de complexité et les éventuels goulots d'étranglement. Analyser les mécanismes de calcul et leur impact sur les performances. Étudier les temps de traitement et les problématiques liées à l'exécution d'un grand nombre de simulations. L'identification des leviers d'optimisation de performance. La proposition de modifications de l'architecture applicative et technique. L'optimisation des traitements et des flux. Définir les principes d'architecture cible. Identifier les composants à conserver, faire évoluer ou remplacer. Définir les interactions entre les différents composants. Étudier les problématiques de performance, robustesse et scalabilité. Vérifier la compatibilité de la cible avec les contraintes techniques et fonctionnelles existantes. Documenter les choix d'architecture et leurs justifications. Contribuer à la définition de la trajectoire d'évolution vers l'architecture cible. Réaliser des POC techniques Valider la pertinence d'une nouvelle architecture. Tester une technologie ou un composant. Mesurer les gains de performance attendus. Livrables attendus Audit de l'architecture et de la solution existante. Analyse des problématiques de performance. Cartographie des principaux composants et flux.
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Permanent

Job VacancyIngénieur électronique analogique - Secteur Militaire H/F

VIVERIS
Published on

40k-55k €
Massy, Ile-de-France
Contexte de la mission : Notre client, acteur reconnu dans le secteur des systèmes embarqués et industriels, recherche un ingénieur électronique analogique pour intégrer son département R&D. Vous évoluerez au sein d'une équipe multidisciplinaire où conception, développement et validation sont clés pour la réussite des projets. Responsabilités : Vous serez responsable de la conception et du développement de circuits électroniques analogiques, depuis les spécifications jusqu'à la validation finale, dans un contexte exigeant d'intégration système. Vos missions: - Concevoir des circuits analogiques (amplificateurs opérationnels, comparateurs, DAC/ADC, gestion de puissance) en suivant les spécifications fonctionnelles - Réaliser des simulations et calculs de performance avec des outils comme LTspice, PSpice, NGSpice, Scilab - Rédiger les dossiers de conception détaillée, fiches de tests et rapports de validation - Participer à la réalisation des prototypes et effectuer les tests en laboratoire (oscilloscopes, analyseurs de spectre, alimentations) - Analyser les résultats, identifier et corriger les phénomènes perturbateurs tels que bruit, distorsion, dérives thermiques - Collaborer étroitement avec les équipes firmware, mécaniques et systèmes pour assurer une intégration optimale - Assurer une veille technologique sur les composants analogiques, les solutions d'optimisation énergétique et la qualité du signal
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