
Offre d'emploi Ingénieur FPGA Confirmé – Conception VHDL & Sécurité Embarquée (H/F)
Île-de-France
Hito
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Hito, ESN spécialisée sur les profils Tech, IT et Cybersécurité, recherche un(e) Ingénieur FPGA pour intégrer l'équipe R&D de l'un de ses clients, éditeur de solutions de sécurité embarquée.
Vous interviendrez sur la conception de composants de chiffrement haute performance, au plus près du matériel. Le code que vous écrivez est gravé dans le silicium et protège des données sensibles : un environnement technique exigeant, à la croisée de l'électronique numérique et de la cryptographie.
Le périmètre inclut un volet d'innovation autour des algorithmes cryptographiques de nouvelle génération.
Vos missions
Analyser les besoins techniques et rédiger les spécifications FPGA
Concevoir des architectures FPGA robustes et performantes
Développer et valider des IP haut débit
Assurer l'intégration matérielle et logicielle des modules FPGA
Réaliser les simulations, tests et validations nécessaires à la qualification produit
Contribuer à la veille technologique et à l'amélioration continue des méthodes de développement
Les livrables
Spécifications techniques, code HDL documenté et validé, rapports de simulation et de validation, documentation d'intégration et de maintenance.
Votre environnement
Vous travaillerez en interaction directe avec les équipes Hardware et Software, les chefs de projet R&D, les experts cryptographie et les équipes Qualité / Industrialisation.
Profil recherché
Indispensable
Formation Bac+5 (école d'ingénieur ou université) en électronique numérique / systèmes embarqués
5 ans d'expérience minimum en conception FPGA sur produits industrialisés
Maîtrise du VHDL et/ou SystemVerilog
Flux de développement Vivado (AMD/Xilinx) et/ou Quartus (Intel/Altera)
Simulation et vérification : ModelSim / QuestaSim / VCS
Maîtrise du timing closure, des contraintes et de l'analyse statique de timing (STA)
Anglais technique écrit
Fortement apprécié
IP haut débit : AXI / AXI4-Stream, PCIe, Ethernet 10G-100G, SerDes, contrôleurs DDR
Implémentation matérielle d'algorithmes cryptographiques (AES, SHA, RSA, ECC, TRNG, arithmétique modulaire)
SoC FPGA : Zynq / Zynq UltraScale+, PolarFire, RISC-V
Vérification structurée : UVM, assertions SVA, cocotb
Notions de cryptographie post-quantique
Sensibilisation aux attaques physiques (side-channel, fault injection, masking)
Expérience en environnement soumis à certification sécuritaire
Prérequis : profil habilitable, en raison du caractère secret défense
Environnement de travail
Pourquoi cette mission
Un sujet technique rare : conception d'IP cryptographiques haut débit, pas de la maintenance
Une exposition à des algorithmes qui seront le standard des dix prochaines années
Un accompagnement Hito sur la durée : suivi de mission, montée en compétences, transparence sur les conditions
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