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À propos du poste Pour accompagner la montée en charge de nos projets microélectroniques complexes, nous recherchons un(e) Ingénieur Conception ASIC & Flot DFT pour piloter l'architecture de testabilité et la préparation aux étapes de Tape-Out.
Vos enjeux au quotidien En lien étroit avec les équipes d'architecture et de synthèse, vous définissez et implémentez la stratégie DFT (scan insertion, ATPG, BIST) tout en participant à la conception RTL des blocs logiques. Vous garantissez un taux de couverture optimal et la répétabilité des tests industriels.
Candidate profile
Technologies : Flot DFT, Scan, ATPG, Boundary Scan, STA, Synthèse logique
Outils : Siemens Tessent, Synopsys Design Compiler, SpyGlass, scripts Tcl/Python
Contexte : ASIC complexes haute performance
Pourquoi rejoindre ce projet ?
Occupez un rôle clé et très recherché au cœur de projets ASIC d'envergure.
Manipulez les outils de CAO les plus performants du marché dans un cadre d'ingénierie pointu.
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