Le poste Architecte SoC
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À propos du poste :
Nous recherchons un Architecte SoC expérimenté pour développer et concevoir l’architecture de nos SoC FPGA. Vous serez responsable de la définition architecturale et de la coordination avec les différentes équipes de conception pour garantir la performance, la qualité et la fiabilité des produits.
Missions principales :
Analyser les besoins et exigences du produit afin de concevoir l’architecture du SoC.
Rédiger et maintenir la documentation technique d’architecture détaillée : cas d’usage, fonctionnalités, partitionnement en blocs fonctionnels, interconnexions et flux, en tenant compte des compromis performance-consommation-surface-routabilité.
Définir, sélectionner et paramétrer les IPs utilisées dans le SoC, et suivre leur intégration avec les équipes.
Travailler en collaboration avec les équipes hardware, vérification, implémentation physique, DFT, prototypage et software embarqué.
Piloter les revues techniques tout au long du cycle de développement pour assurer la conformité avec les spécifications d’architecture.
Définir l’interface entre le SoC et le FPGA avec l’équipe FPGA.
Participer à la montée en compétence des équipes sur les concepts techniques complexes et partager les bonnes pratiques.
Collaborer avec le chef de projet technique et les managers pour sécuriser les développements et livrer un produit fonctionnel, industrialisable et fiable dans les délais impartis.
Profil recherché
Profil recherché :
Expérience confirmée : minimum 10 ans en architecture SoC, avec leadership et capacité à fédérer les équipes.
Maîtrise des problématiques SoC/ASIC et des principales IPs et fonctionnalités : processeurs (ARM), cohérence de cache, SMMU, virtualisation, sécurité matérielle, interconnexions, mémoires internes et externes, périphériques (PCIe, Ethernet, USB, UART, High Speed Links), trace, debug et gestion des erreurs.
Connaissance du partitionnement en "chiplet" est un plus.
Capacité à travailler en interface avec plusieurs équipes techniques et à encadrer des revues et validations d’architecture.
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